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文檔簡介
1、一、 填空題(每空1分,共20分)1、與非門的邏輯功能為 全1出0,有0出1 。2、數(shù)字信號的特點是在 時間 上和 幅度 上都是斷續(xù)變化的,其高電平和低電平常用 0 和 1 來表示。3、三態(tài)門的“三態(tài)”指 高電平 , 低電平和 高阻狀態(tài) 。4、TTL與非門、TTL異或門、集電極開路與非門和三態(tài)門,能夠?qū)崿F(xiàn)線與功能的是 集電極開路與非門 。5、CMOS門電路和TTL門電路相比,工作速度快的是 TTL門電路,功耗小的是CMOS門電路。6、兩輸入與非門輸入為01時,輸出為_1_。7、函數(shù)Y=AB+A的最小項表達式為_。8、組合邏輯電路是指任何時刻,電路的輸出狀態(tài)僅由該時刻_各輸入狀態(tài)_決定。9、使用
2、OC門時,輸出端應(yīng)接上_負載電阻_和電源才能正常的工作。4、為了實現(xiàn)高的頻率穩(wěn)定度,常采用 振蕩器;單穩(wěn)態(tài)觸發(fā)器受到外觸發(fā)時進入 態(tài)6、同步RS觸發(fā)器中R、S為 電平有效,基本R、S觸發(fā)器中R、S為 電平有效 7、在進行A/D轉(zhuǎn)換時,常按下面四個步驟進行, 、 、 、 。1、(1010110.0101)8421BCD表示的二進制數(shù)( ),十六進制數(shù)( )。4、要組成容量為16K×32位的ROM,需要( )片容量為4K×8位的ROM。5、在下列JK觸發(fā)器、RS 觸發(fā)器、D觸發(fā)器 和T觸發(fā)器四種觸發(fā)器中,同時具有 保持、置1、置0和翻轉(zhuǎn)功能的觸發(fā)器是( )。6、邏輯函數(shù)式等于(
3、 )。7、和CMOS門電路相比,TTL門電路的工作速度( ),功耗( )。8、TTL與非門、TTL異或門、集電極開路與非門和三態(tài)門,能夠?qū)崿F(xiàn)線與功能的是( )。1兩輸入與非門輸入為01時,輸出為_。2邏輯變量和邏輯函數(shù)只有_兩種取值,而且它們只是表示兩種不同的邏輯狀態(tài)。3函數(shù)Y=AB+A的最小項表達式為_。4使用OC門時,輸出端應(yīng)接上_和電源才能正常的工作。5組合邏輯電路是指任何時刻電路的輸出僅由當(dāng)時的_決定。68線3線優(yōu)先編碼器74LS148的優(yōu)先編碼順序是,輸出。輸入輸出均為低電平有效。當(dāng)輸入為11010101時,輸出為_。7D觸發(fā)器,當(dāng)D與_相連時,轉(zhuǎn)化為T觸發(fā)器。8某計數(shù)器的輸出波形如
4、圖1所示,該計數(shù)器是_進制計數(shù)器。9設(shè)計一個8421BCD碼加法計數(shù)器,至少需要_個觸發(fā)器。10雙積分型A/D轉(zhuǎn)換器相對逐次比較型A/D轉(zhuǎn)換器的轉(zhuǎn)換速度要_。2.n個變量的邏輯函數(shù)共有最小項_個。3.標準TTL反相器的關(guān)門電阻約為_。4.全加器的輸入比半加器多一個端口,該端口信號來自_。5.數(shù)據(jù)分配器和_有相同的基本電路結(jié)構(gòu)形式。6.有約束條件的觸發(fā)器是_。7.最大長度移位寄存器的反饋電路一般由_門組成。8.制作ASIC的方法分為_、現(xiàn)場可編程方法。9.單穩(wěn)態(tài)觸發(fā)器的非重觸發(fā)是指在_期間不能接收新的觸發(fā)信號。10.轉(zhuǎn)換速度最快的A/D轉(zhuǎn)換器是_型。2.德·摩根定理之一是=_。3.標準
5、TTL反相器的閾值電壓Uth=_。4.二進制譯碼器的輸出端提供了輸入變量的_。5.能將1個數(shù)據(jù)根據(jù)需要傳送到多個端口之一的電路稱為_。6.觸發(fā)器可以接受、保存和_信號。7.8位單向移位寄存器完成串行輸入需要_個CP脈沖。8.可編程邏輯器件的通用陣列邏輯英文縮寫是_。9.施密特觸發(fā)器能夠把變化_的輸入整形為適合數(shù)字電路的信號。10.輸出3位的并聯(lián)比較型A/D轉(zhuǎn)換器有比較器_個。1.在組合電路中,當(dāng)輸入信號改變狀態(tài)時,輸出端可能出現(xiàn)虛假信號過渡干擾脈沖的現(xiàn)象,叫做_。2.一般的A/D轉(zhuǎn)換過程要經(jīng)過取樣、保持、_和_四個步驟完成。3.只有在時鐘的上升沿或下降沿時刻,輸入信號才能被接收,該種觸發(fā)器是_
6、。4.邏輯代數(shù)中的基本運算關(guān)系有_、_、_三種。5n變量的邏輯函數(shù)有_個最小項,任意兩個不同的最小項之積為_。6譯碼器的功能是對具有特定含義的輸入代碼進行“翻譯”,將其轉(zhuǎn)換成相應(yīng)的輸出信號。_的功能與譯碼器的功能相反。7可擦除可編程ROM叫做_,其存儲的數(shù)據(jù)可以改寫。8.觸發(fā)器接收輸入信號之前的狀態(tài)叫做現(xiàn)態(tài),用_表示;觸發(fā)器接收輸入信號之后的狀態(tài)叫做次態(tài),用_表示。9.n位二進制計數(shù)器的模為_。102048×8位的RAM有_根地址線,_根數(shù)據(jù)線。11_只有一個穩(wěn)定狀態(tài),一個暫穩(wěn)態(tài),在外加脈沖的作用下,可以從一個穩(wěn)定狀態(tài)翻轉(zhuǎn)到一個暫穩(wěn)態(tài)。12三態(tài)門有三種輸出狀態(tài),分別是:_、_和_。2
7、將2004個“1”異或起來得到的結(jié)果是( 0 )。3半導(dǎo)體存儲器的結(jié)構(gòu)主要包含三個部分,分別是( 地址譯碼器 、(存儲矩陣)、( 輸出緩沖器 )。48位D/A轉(zhuǎn)換器當(dāng)輸入數(shù)字量10000000為5v。若只有最低位為高電平,則輸出電壓為( 0.039 )v;當(dāng)輸入為10001000,則輸出電壓為( 5.31 )v。5就逐次逼近型和雙積分型兩種A/D轉(zhuǎn)換器而言,( 雙積分型 )的抗干擾能力強,( 逐次逼近型 )的轉(zhuǎn)換速度快。6由555定時器構(gòu)成的三種電路中,( 施密特觸發(fā)器 )和( 單穩(wěn)態(tài)觸發(fā)器)是脈沖的整形電路。7與PAL相比,GAL器件有可編程的輸出結(jié)構(gòu),它是通過對( 結(jié)構(gòu)控制字 )進行編程設(shè)
8、定其( 輸出邏輯宏單元 )的工作模式來實現(xiàn)的,而且由于采用了( E2CMOS)的工藝結(jié)構(gòu),可以重復(fù)編程,使它的通用性很好,使用更為方便靈活。1邏輯函數(shù)有四種表示方法,它們分別是( 真值表、)、( 邏輯圖式 )、( 、邏輯表達 )和( 、卡諾圖 )。2將2004個“1”異或起來得到的結(jié)果是( )。3由555定時器構(gòu)成的三種電路中,( )和( )是脈沖的整形電路。4TTL器件輸入腳懸空相當(dāng)于輸入( )電平。5基本邏輯運算有: ( )、( )和( )運算。6采用四位比較器對兩個四位數(shù)比較時,先比較( )位。7觸發(fā)器按動作特點可分為基本型、( )、( )和邊沿型;8如果要把一寬脈沖變換為窄脈沖應(yīng)采用
9、( ) 觸發(fā)器9目前我們所學(xué)的雙極型集成電路和單極型集成電路的典型電路分別是( )電路和( )電路。10施密特觸發(fā)器有( )個穩(wěn)定狀態(tài).,多諧振蕩器有( )個穩(wěn)定狀態(tài)。11數(shù)字系統(tǒng)按組成方式可分為 、 兩種;12兩二進制數(shù)相加時,不考慮低位的進位信號是 ( ) 加器。13不僅考慮兩個_相加,而且還考慮來自_相加的運算電路,稱為全加器。14時序邏輯電路的輸出不僅和_有關(guān),而且還與_有關(guān)。15計數(shù)器按CP脈沖的輸入方式可分為_和_。16觸發(fā)器根據(jù)邏輯功能的不同,可分為_、_、_、_、_等。17根據(jù)不同需要,在集成計數(shù)器芯片的基礎(chǔ)上,通過采用_、_、_等方法可以實現(xiàn)任意進制的技術(shù)器。184. 一個
10、JK 觸發(fā)器有 個穩(wěn)態(tài),它可存儲 位二進制數(shù)。 19若將一個正弦波電壓信號轉(zhuǎn)換成同一頻率的矩形波,應(yīng)采用 電路。20 把JK觸發(fā)器改成T觸發(fā)器的方法是 。21N個觸發(fā)器組成的計數(shù)器最多可以組成 進制的計數(shù)器。22基本RS觸發(fā)器的約束條件是 。23對于JK觸發(fā)器,若,則可完成 T 觸發(fā)器的邏輯功能;若,則可完成 D 觸發(fā)器的邏輯功能。1. 有一數(shù)碼10010011,作為自然二進制數(shù)時,它相當(dāng)于十進制數(shù)( ),作為8421BCD碼時,它相當(dāng)于十進制數(shù)( )。2.三態(tài)門電路的輸出有高電平、低電平和( )3種狀態(tài)。3TTL與非門多余的輸入端應(yīng)接( )。 4TTL集成JK觸發(fā)器正常工作時,其和端應(yīng)接( )電平。5. 已知某函數(shù),該函數(shù)的反函數(shù)=( )。 6. 如果對鍵盤上108個符號進行二進制編碼,則至少要( )位二進制數(shù)碼。7. 典型的TTL與非門電路使用的電路為電源電壓為( )V,其輸出高電平為( )V,輸出低電平為( )V, CMOS電路的電源電壓為( ) V 。874LS138是3線8線譯碼器,譯碼為輸出低電平有效,若輸入為A2A1A0=110時,輸出 應(yīng)為( )。9將一個包含有32768個基本存儲單元的存儲電路設(shè)計16位為一個
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