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文檔簡介
ABEL語音源文件基本格式規(guī)則
ABEL語音是美國DATAI/O公司開發(fā)的一種邏輯設(shè)計軟件,它是最早流行的硬件描述語言,簡單易學(xué),有多種EDA開發(fā)軟件支持。它能支持多種型號的PLD器件(主要是Lattice公司的芯片)。ABEL-HDL硬件描述語言硬件描述語音與原理圖邏輯設(shè)計相比有如下特點(diǎn):以文本形式表示邏輯電路的結(jié)構(gòu)和行為,可直接將邏輯方程、真值表或狀態(tài)圖轉(zhuǎn)換為硬件描述語言的形式設(shè)計精確簡練,便于閱讀和分析易于設(shè)計修改、調(diào)用、共享和更新與原理圖混合設(shè)計,構(gòu)成“自頂而下”的層次化設(shè)計方法ABLE-HDL源文件基本格式五個部分模塊頭設(shè)計說明設(shè)計描述設(shè)計仿真結(jié)束模塊4位二進(jìn)制數(shù)值比較器ABEL源文件Modulecomp4
Title‘4位二進(jìn)制數(shù)值比較器’Declaration A3,A2,A1,A0 pin; B3,B2,B1,B0 pin; A_NE_B,A_EQ_B,A_GT_B,A_LT_Bpinistype’com’;
No,Yes=0,1; A=[A3,A2,A!,A0]; B=[B3,B2,B1,B0];Equations A_EQ_B=(A==B); A_GT_B=!(A==B); A_GT_B=A>B; A_LT_B=A<B;Test_Vectors([A,B]->[A_EQ_B,A_GT_B,A_LT_B,A_NE_B]) [0,0]->[Yes,No,No,No]; [1,0]->[No,Yes,No,Yes]; [3,9]->[No,No,Yes,Yes];END 模塊頭部分設(shè)計說明部分設(shè)計描述部分設(shè)計仿真部分結(jié)束部分一、模塊頭部分格式:MODULE模塊名模塊名由用戶自定義例:MODULE4comp表明ABEL硬件描述的開始說明:此語句是必須的,它是一個模塊的頭,而且必須有一個END語句與之相配合,模塊名相當(dāng)于元件符號。二、設(shè)計說明部分1、TITLE標(biāo)題語句:
TITLE‘字符串’例:Title‘4位二進(jìn)制數(shù)值比較器’提供設(shè)計的說明信息:設(shè)計題目、設(shè)計者單位和姓名、設(shè)計時間、輸入信號、輸出信號、內(nèi)部信號、引腳屬性、常量定義說明:此語句是可選的,主要說明模塊的內(nèi)容、用途、作者、設(shè)計時間和地點(diǎn),單引號內(nèi)為說明內(nèi)容。2、Device器件定義語句:器件名DEVICE實(shí)際器件;例:U09DEVICE‘P16V8S’器件名即設(shè)計模塊中所用的標(biāo)識符,實(shí)際器件為實(shí)際器件的工業(yè)型號,用字符串表示。說明:在ispLever
軟件中,實(shí)際器件是在菜單下選擇的,故器件定義語句可以省去。二、設(shè)計說明部分3、Pin管腳定義語句:[!]信號名…PIN[管腳號…]ISTYPE[,屬性];例:!Clock,Reset,S1PIN12,15,3;說明:管腳定義語句說明信號標(biāo)識符與真實(shí)器件管腳之間的關(guān)系,并給出可編程管腳的屬性?!?”表示低電平有效。二、設(shè)計說明部分4、NODE節(jié)點(diǎn)定義語句::
[!]節(jié)點(diǎn)名…NODE[節(jié)點(diǎn)號…]ISTYPE[,屬性];例:ANODE12=‘pos,com’;
表示節(jié)點(diǎn)12名為A,為正極性且信號為組合型。說明:節(jié)點(diǎn)定義語句和管腳定義語句類似,代表器件內(nèi)部的中間信號,稱為“偽管腳”。二、設(shè)計說明部分5、常量定義語句:常量名[,常量名]…=表達(dá)式[,表達(dá)式]…;例:
X=.X.;C=.C.;A=[!B,D];
說明:簡化程序設(shè)計。二、設(shè)計說明部分6、宏定義語句及擴(kuò)展:
宏名MACRO([啞變量,[啞變量]…]){塊};
宏定義中的塊可以用邏輯表達(dá)式描述,也可以用真值表來描述。例:用宏定義一個三輸入與非門。
①用邏輯表達(dá)式描述:
NAND3MACRO(A,B,C){!(?A&?B&?C)};
調(diào)用:D=NAND3(Clock,Hello,Busy);
則:D=!(Clock&Hello&Busy);二、設(shè)計說明部分例:用宏定義一個三輸入與非門。
②用真值表描述:
NAND3MACRO(A,B,C){TRUTH_TABLE([?A,?B,?C]->?Y)[0,.X.,.X.]->1;[.X.,0,.X.]->1;[.X.,.X.,0]->1;[1,1,1]->0;};
調(diào)用:D=NAND3(Clock,Hello,Busy);
則:TRUTH_TABLE([Clock,Hello,Busy]->D)[0,.X.,.X.]->1;[.X.,0,.X.]->1;[.X.,.X.,0]->1;[1,1,1]->0;};7、ISTYPE屬性定義語句:
信號名[,信號名]…ISTYPE‘屬性[,屬性]…’;屬性定義語句用于對管腳或節(jié)點(diǎn)具有可編程特性的器件進(jìn)行屬性定義,使具體的器件形成正確的邏輯并使設(shè)計優(yōu)化。
ISTYPE屬性定義語句必須放在DEVICE器件定義語句、PIN管腳定義語句、NODE節(jié)點(diǎn)定義語句之后。例:
OUT0,OUT1,OUT2PIN3,4,5ISTYPE‘COM’;OUT3,OUT4PIN6,7ISTYPE‘REG’;二、設(shè)計說明部分管腳、節(jié)點(diǎn)常用屬性:關(guān)鍵字說明Pos正極性Neg
負(fù)極性Com組合邏輯輸出Reg寄存器輸出Buffer寄存器緩沖輸出Invert寄存器反相緩沖輸出Latch鎖存輸入Reg_dD觸發(fā)器輸出Reg_rsRS觸發(fā)器輸出Reg_jkJK觸發(fā)器輸出Reg_TT觸發(fā)器輸出
ABEL語言描述邏輯功能的方法有三種:
☆邏輯方程
☆真值表
☆狀態(tài)機(jī)三、設(shè)計描述部分1、邏輯方程:關(guān)鍵字EQUATIONS表示一組邏輯方程的開始。例:
EQUATIONSA=B&C#D;[W,Y]=3;!F=(B==C);WHEN(select==0)THENy=a;2、真值表:關(guān)鍵字TRUTH_TABLE表示一組邏輯方程的開始。例:TRUTH_TABLE([en,A,B]->Y)[0,.X.,.X.]->.Z.;[1,0,0]->0;[1,0,1]->1;[1,1,0]->1;[1,1,1]->0;3、狀態(tài)機(jī):關(guān)鍵字STATE_DIAGRAM表示一組邏輯方程的開始。例:
STATE_DIAGRAM[A,B]STATE3:Y=3;GOTO1;STATE1:Y=1;GOTO2;STATE2:Y=2;GOTO3;四、設(shè)計仿真部分測試向量表:
TEST_VECTORS(輸入向量->輸出向量)
[輸入信號值->輸出信號值;]
[輸入信號值->輸出信號值;]
……例:
TEST_VECTORS([A,B]->[C,D])0->1;1->2;2->3;3->0;五、設(shè)計結(jié)束部分END表示設(shè)計模塊結(jié)束ABLE硬件描述語音規(guī)則一、基本語法1、關(guān)鍵字、標(biāo)識符及數(shù)字之間必須用一個或一個以上的空格分開,以下情況除外:(1)一系列標(biāo)識符可以用逗號分開。例A,B,Cpin;(2)表達(dá)式中的數(shù)字與標(biāo)識符之間可以用運(yùn)算符分開。例Y=!A&B&!C;(3)園括號可起分隔符的作用例Test_Vectors(cp->Q)2、關(guān)鍵字、標(biāo)識符、運(yùn)算符及數(shù)字中間不能嵌入空格:錯誤正確例MODULEMODULE例Y1=!A&B&!C;Y1=!A&B&!C;例>=>=
例12341234
空格可以出現(xiàn)在字符串、注釋行、程序塊及實(shí)變量中例:‘Thisis……’
例://thisis3、關(guān)鍵字不區(qū)分大小寫:例MODULEModule
module
4、標(biāo)識符區(qū)分大小寫:例A_EQ_B
a_eq_b
A_eq_b
二、合法的ASCII碼所有大寫、小寫字母及一般鍵盤使用的大部分字符均為合法字符標(biāo)識符代表器件、器件管腳、節(jié)點(diǎn)、集合、輸入信號、輸出信號、宏、常量及變量等。用戶自定義標(biāo)識符不能超過31個字符標(biāo)識符必須以字母或下劃線開頭除首字符外,標(biāo)識符可由大小寫字母、數(shù)字、波浪號~和下劃線組成標(biāo)識符中不能有空格標(biāo)識符中不能有句號“.”標(biāo)識符不能和關(guān)鍵字(即保留字)重名例:AB1This_is_input
1A$Bhel.loThisisinput見名知意三、標(biāo)識符:又叫保留標(biāo)識符,ABEL語言本身使用,已有明確的特殊含義。不能給器件、器件管腳、節(jié)點(diǎn)、集合、輸入信號、輸出信號、宏、常量及變量等命名為標(biāo)識符。常用的關(guān)鍵字如下:Truth_tableDeclarationsDeviceEndEquationsGotoIstypeMacroModuleNodePinStateState_diagramTest_vect
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